Table 66. MMA8452Q Register Map
Reg
00
01
02
03
04
05
06
0B
0C
0D
0E
0F
10
11
12
13
14
15
16
Name
STATUS
OUT_X_MSB
OUT_X_LSB
OUT_Y_MSB
OUT_Y_LSB
OUT_Z_MSB
OUT_Z_LSB
SYSMOD
INT_SOURCE
WHO_AM_I
XYZ_DATA_CFG
HP_FILTER_CUTOFF
PL_STATUS
PL_CFG
PL_COUNT
PL_BF_ZCOMP
P_L_THS_REG
FF_MT_CFG
FF_MT_SRC
Definition
Data Status R
12-bit X Data R
12-bit X Data R
12-bit Y Data R
12-bit Y Data R
12-bit Z Data R
12-bit Z Data R
System Mode R
Interrupt Status R
ID Register R
Data Config R/W
HP Filter Setting R/W
PL Status R
PL Configuration R/W
PL DEBOUNCE R/W
PL Back/Front Z Comp
R
PL THRESHOLD R
Freefall/Motion Config
R/W
Freefall/Motion Source
R
Bit 7
ZYXOW
XD11
XD3
YD11
YD3
ZD11
ZD3
0
SRC_ASLP
0
0
0
NEWLP
DBCNTM
DBNCE[7]
BKFR[1]
P_L_THS[4]
ELE
EA
Bit 6
ZOW
XD10
XD2
YD10
YD2
ZD10
ZD2
0
0
0
0
0
LO
PL_EN
DBNCE[6]
BKFR[0]
P_L_THS[3]
OAE
0
Bit 5
YOW
XD9
XD1
YD9
YD1
ZD9
ZD1
0
SRC_TRANS
1
0
Pulse_HPF_BYP
0
0
DBNCE[5]
0
P_L_THS[2]
ZEFE
ZHE
Bit 4
XOW
XD8
XD0
YD8
YD0
ZD8
ZD0
0
SRC_LNDPRT
0
HPF_OUT
Pulse_LPF_EN
0
0
DBNCE[4]
0
P_L_THS[1]
YEFE
ZHP
Bit 3
ZYXDR
XD7
0
YD7
0
ZD7
0
0
SRC_PULSE
1
0
0
0
0
DBNCE[3]
0
P_L_THS[0]
XEFE
YHE
Bit 2
ZDR
XD6
0
YD6
0
ZD6
0
0
SRC_FF_MT
0
0
0
LAPO[1]
0
DBNCE[2]
ZLOCK[2]
HYS[2]
0
YHP
Bit 1
YDR
XD5
0
YD5
0
ZD5
0
SYSMOD1
0
1
FS1
SEL1
LAPO[0]
0
DBNCE[1]
ZLOCK[1]
HYS[1]
0
XHE
Bit 0
XDR
XD4
0
YD4
0
ZD4
0
SYSMOD0
SRC_DRDY
0
FS0
SEL0
BAFRO
0
DBNCE[0]
ZLOCK[0]
HYS[0]
0
XHP
Freefall/Motion
17
FF_MT_THS
Threshold
DBCNTM
THS6
THS5
THS4
THS3
THS2
THS1
THS0
R/W
Freefall/Motion
18
FF_MT_COUNT
Debounce
D7
D6
D5
D4
D3
D2
D1
D0
R/W
1D
1E
1F
20
21
22
23
24
25
26
27
28
29
2A
2B
TRANSIENT_CFG
TRANSIENT_SRC
TRANSIENT_THS
TRANSIENT_COUNT
PULSE_CFG
PULSE_SRC
PULSE_THSX
PULSE_THSY
PULSE_THSZ
PULSE_TMLT
PULSE_LTCY
PULSE_WIND
ASLP_COUNT
CTRL_REG1
CTRL_REG2
Transient Config R/W
Transient Source R
Transient Threshold R/W
Transient Debounce
R/W
Pulse Config R/W
Pulse Source R
Pulse X Threshold R/W
Pulse Y Threshold R/W
Pulse Z Threshold R/W
Pulse First Timer R/W
Pulse Latency R/W
Pulse 2nd Window
R/W
Auto-SLEEP Counter
R/W
Control Reg1 R/W
Control Reg2 R/W
0
0
DBCNTM
D7
DPA
EA
0
0
0
TMLT7
LTCY7
WIND7
D7
ASLP_RATE1
ST
0
EA
THS6
D6
ELE
AxZ
THSX6
THSY6
THSZ6
TMLT6
LTCY6
WIND6
D6
ASLP_RATE0
RST
0
ZTRANSE
THS5
D5
ZDPEFE
AxY
THSX5
THSY5
THSZ5
TMLT5
LTCY5
WIND5
D5
DR2
0
ELE
Z_Trans_Pol
THS4
D4
ZSPEFE
AxX
THSX4
THSY4
THSZ4
TMLT4
LTCY4
WIND4
D4
DR1
SMODS1
ZTEFE
YTRANSE
THS3
D3
YDPEFE
DPE
THSX3
THSY3
THSZ3
TMLT3
LTCY3
WIND3
D3
DR0
SMODS0
YTEFE
Y_Trans_Pol
THS2
D2
YSPEFE
Pol_Z
THSX2
THSY2
THSZ2
TMLT2
LTCY2
WIND2
D2
LNOISE
SLPE
XTEFE
XTRANSE
THS1
D1
XDPEFE
Pol_Y
THSX1
THSY1
THSZ1
TMLT1
LTCY1
WIND1
D1
F_READ
MODS1
HPF_BYP
X_Trans_Pol
THS0
D0
XSPEFE
Pol_X
THSX0
THSY0
THSZ0
TMLT0
LTCY0
WIND0
D0
ACTIVE
MODS0
Control Reg3
2C
CTRL_REG3
(WAKE Interrupts from
0
WAKE_TRANS
WAKE_LNDPRT
WAKE_PULSE
WAKE_FF_MT
0
IPOL
PP_OD
SLEEP) R/W
Control Reg4
2D
CTRL_REG4
(Interrupt Enable Map)
INT_EN_ASLP
0
INT_EN_TRANS
INT_EN_LNDPRT
INT_EN_PULSE
INT_EN_FF_MT
0
INT_EN_DRDY
R/W
MMA8452Q
Sensors
Freescale Semiconductor, Inc.
41
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